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從DDR4到DDR5 看高速連接器如何助力

    作者:宏拓新軟件
    發布日期:2019-11-25         
閱讀:79     
 
 

10月30日,在深圳市連接器行業協會和Intel聯合主辦的“高速連接器/電纜研討會”上,李祥博士帶來了信號完整性基礎、DDR5 連接器設計和標準制定、USB4™ Type C 連接器和線纜的設計和規范制定、高速連接器/線纜的SI仿真建模以及高速連接器/線纜的SI測試治具設計和測試方法這五大主題的演講。概括起來,就是一款產品從建模仿真到根據模型優化,再到設計測試板測試的過程。

此次的主講人李祥博士為英特爾公司資深硬件工程師、USB Type-C®小組主要成員、JEDEC JC11.14協會主席,自2007年開始接觸連接器,至今已有12年的行業經驗。

當前,數據中心的運營商均致力于跟上數據傳輸方面的要求。他們必須尋求各種方式來滿足數據和存儲上日新月異的需求,同時確保服務質量、降低成本。因此,對于部分數據中心運營商來說,降低功耗都是他們的首當要務,從而降低運營費用。

連接器

雙數據速率 5 內存,其官方簡稱為 DDR5,目標在于提供數據中心所需的增強性能以及功率管理功能,為 400GE 的網絡速度提供良好支持。

根據計劃,DDR5 將提供兩倍于 DDR4 的帶寬和密度,同時還改善了信道的效率。這些增強功能與針對服務器和客戶端平臺而提供的更加易用的接口結合到一起,將在一系列廣泛的應用中實現極高的性能并改進功率管理。

在“DDR5 連接器設計和標準制定”中,李祥以服務器板(2012)為例,闡述如何增加內存帶寬,即通過更高的數據傳輸速率以及更多波段。隨后還介紹了SMT連接器的主要問題,從成本上看,SMT連接器比PTH連接器貴;從可靠性上看,其焊接性、返工可行性和結構較好。

據了解,DDR5 的確需要更高的速度。如果采用 SMT 端接,那么在工藝上可能會存在挑戰,與 TH 或 PF 端接方式相比或許更難以加工。CTE 與印刷電路板的不匹配會造成連接器的動態翹曲。

最后,他重點講解了DDR5連接器(SO-023)的更改,依次是為裝配互操作性添加參考終端設計、增加窄閂鎖設計、提高散熱,以及在規范中添加硬托盤設計,以實現軟件包的互操作性。

 

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